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LDMOS RF Power-Amplifier Bias
Controller
Functional Diagram
V CC
V CC
ON-CHIP
TEMP SENSOR
SDA
SCL
I 2 C INTERFACE
CONTROL
32 BYTES
GAIN
CALIBRATION
REGISTERS
V CC
A 0
A 1
A 2
ADDRESS
GENERATION
USER
MEMORY
OFFSET
CALIBRATION
REGISTERS
+
∑
+
13-BIT
ADC
V D
I D1
I D2
I 2 C DATA BUS
V D
I D1
V D
I D2
LOAD
INDEX
POT1
VD1
INDEX
POT2
VD2
MEASURED
VALUES FOR
TEMP, V CC ,
V D , I D0 , I D1
LIMIT FLAG
REGISTERS
DRAIN
LUT
DRAIN
LUT
FAULT
TABLE 4
(64 BYTES)
TABLE 5
(64 BYTES)
HI AND LO
LIMITS FOR
TEMP, V CC ,
LIMIT
COMPARATOR
FAULT
MASK
LOAD
TEMP
INDEX
INDEX
V D , I D1 , I D2
POT1
TEMP
LUT
TABLE 2
(72 BYTES)
POT2
TEMP
LUT
TABLE 3
(72 BYTES)
+
∑
+
DS1870
POT2
R POT
H COM
W 2
L 2
R S
GND
+
+
∑
R S
POT1
R POT
W 1
L 1
_____________________________________________________________________
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